Name: iBasso D16 TAIPAN Hi-Res Portable DAC & Amplifier
SKU: 65b764b09466340023488f15
Price: 10999.0 HKD
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iBasso D16 TAIPAN Hi-Res Portable DAC & Amplifier

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【便攜 1bit 超甲類分立元件解碼耳擴新高峰 - iBasso D16 】

D16 是一款採用 iBasso 自研 FPGA-Master 2.0 為核心，通過 16 組 8E 的 PWM-DAC，共 128 個 PWM-DAC（分立元件）進行 1bit 解碼的音訊解碼器。

簡單點說是 FPGA+ 分立元件解碼的 1bit 解碼器。實測 THD+N 優於 0.0001%，在目前便攜分立元件解碼器裡獨佔鰲頭。耳擴部分為類似於 DX320MAX 的超甲類電晶體耳擴。

採用 128 顆低溫漂 0.1% 高精度 25ppm 薄膜電阻。
定制 24 級四聯步進式電位器，左右聲道差異小於 +/-0.1dB。
採用兩顆 Accusilicon 超低相位噪音飛秒晶振，底噪低至 -158dBc/Hz（@1kHz）。
專業音訊 DSP 晶片，理論動態範圍高達 192dB，THD+N 達到 -174dB。
超低雜訊模擬電源，雜訊低至 0.6μV，比 0.8μV 的淩特 LT304x 更低。
1.3 英寸 OLED 顯示幕。

產品特色

FPGA-Master 2.0 信號再生及優化時鐘，統領全域

D16 的 FPGA-Master 2.0 加入了 iBasso 過去 3 年的演算法大成，是分立元件 DAC 指標取得重大突破的重點所在。

FPGA 起到信號重組，重新編碼的作用。產生能供後級 PWM-DAC 解碼的 PWM 信號。
當 THD 指標上去之後，降低噪音是獲得更高動態範圍的攔路虎。控制噪音是困擾 DAC 研發從業者的一個問題。D16 的 FPGA-Master 2.0 擁有先進的噪音整形，有效讓難纏的噪音進一步降低。
全域時鐘再生技術，兩顆 Accusilicon 飛秒晶振給 FPGA 提供時鐘源經由 FPGA 再生成 DSP 和 USB 橋接晶片所需要的同步低相位雜訊時鐘，也產生 FPGA 工作的驅動源頭。（1bit DAC 對時鐘的抖動/相位雜訊非常敏感，我們測試過多款各類品牌“飛秒晶振”，Accusilicon 的專業音訊晶振，低至 -158dBc/Hz@1kHz 的相位雜訊，是整機指標的保證。相比一般的飛秒晶振的 -145dBc/Hz，相位雜訊降低了 13dB。）
皮秒級精確時延控制可設置 I/O 時延，對“佈線延時”進行補償，使得資料到達 DAC 端的邊沿是對齊和嚴格同步的。
憑藉 FPGA-Master 2.0 對 128 個獨立 PWM-DAC 的精准控制，實現硬體 FIR 模式。L+，L-，R+，R- 每通道 32 個 PWM-DAC 合成的輸出，不僅可以獲得高指標，也得到極高的聲音密度和解析力。

分立元件 DAC 128 顆 PWM-DAC，數量及精度雙優勢

128 顆 PWM-DAC，數量及精度雙優勢，當 FPGA 產生了用於解碼的 PWM 信號後，進入分立元件 DAC 進行解碼。D16 採用 16 組 8E PWM-DAC 級聯。L+，L-，R+，R- 每通道各 32E。PWM-DAC 數量是其他便攜分離 DAC 的 6.4 倍以上。憑藉解碼及數量上的雙重優勢。實現 THD+N 優於 0.0001% 的壯舉。

硬體類比 FIR 濾波器

通過 FPGA-Master 2.0，實現對 DAC 時鐘和資料進行皮秒級精確控制和調整，讓每一路 DAC 資料都實現獨立可調。L+，L-，R+，R- 每通道 32 顆 PWM-DAC “分時並聯”形式，讓 32 顆 DAC 構成一個硬體類比 FIR 濾波器，平均化多個 DAC 之間的差異，降低失真，有效提高聲音細節和密度。